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填空題
Verilog HDL的功能描述是用來(lái)描述設(shè)計(jì)模塊的（）和模塊端口間的（）。
答案：
內(nèi)部結(jié)構(gòu)；邏輯關(guān)系
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填空題
Verilog HDL的模塊Verilog HDL模塊的T/O聲明用來(lái)聲明模塊端口定義中各端口數(shù)據(jù)流動(dòng)方向，包括（）、（）和（）。
答案：
輸入（input）；輸出（output）；雙向（inout）
