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問答題
【論述題】給出某個(gè)一般時(shí)序電路的圖，有Tsetup、Tdelay、Tck->q，還有clock的delay，寫出決定最大時(shí)鐘的因素，同時(shí)給出表達(dá)式。
答案：
T+Tclkdealy>Tsetup+Tco+Tdelay；
Thold>Tclkdelay+Tco+Tdel...
Thold>Tclkdelay+Tco+Tdel...
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問答題
【論述題】時(shí)鐘周期為T，觸發(fā)器D1的建立時(shí)間最大為T1max，最小為T1min。組合邏輯電路最大延遲為T2max，最小為T2min。問，觸發(fā)器D2的建立時(shí)間T3和保持時(shí)間T4應(yīng)滿足什么條件？
答案：
首先說下建立時(shí)間和保持時(shí)間的定義。
建立時(shí)間（setuptime）是指在觸發(fā)器的時(shí)鐘信號(hào)上升沿到來以前，數(shù)據(jù)穩(wěn)...
建立時(shí)間（setuptime）是指在觸發(fā)器的時(shí)鐘信號(hào)上升沿到來以前，數(shù)據(jù)穩(wěn)...
問答題
【論述題】Moore與Mealy狀態(tài)機(jī)的特征是什么？
答案：
Moore狀態(tài)機(jī)的輸出僅與當(dāng)前狀態(tài)值有關(guān)，且只在時(shí)鐘邊沿到來時(shí)才會(huì)有狀態(tài)變化.Mealy狀態(tài)機(jī)的輸出不僅與當(dāng)前狀態(tài)值有關(guān)...
