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填空題

以EDA方式設(shè)計實現(xiàn)的電路設(shè)計文件，最終可以編程下到（）和（）芯片中，完成硬件設(shè)計和驗證。

答案： FPGA；CPLD

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圖形文件設(shè)計結(jié)束后一定要通過（），檢查設(shè)計文件是否正確。

答案：仿真

VHDL的數(shù)據(jù)對象包括（）、（）和（），它們是用來存放各種類型數(shù)據(jù)的容器。

答案：變量；常量；信號

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