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單項(xiàng)選擇題

TTL集成電路74LS138是3/8線譯碼器，譯碼器為輸出低電平有效，若輸入為時(shí)，輸出：為（）。

A.00100000
B.11011111
C.11110111
D.00000100

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單項(xiàng)選擇題

半加器和的輸出端與輸入端的邏輯關(guān)系是（）

A.與非
B.或非
C.與或非
D.異或

單項(xiàng)選擇題

L=AB+C的對(duì)偶式為：（）

A.A+BC；
B.（A+B）C；
C.A+B+C；
D.ABC；